Prestations de layout de circuits intégrés analogiques et mixtes (Люксембург - Тендер #70187550) | ||
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Страна: Люксембург (другие тендеры и закупки Люксембург) Организатор тендера: CEA Grenoble Номер конкурса: 70187550 Дата публикации: 23-01-2026 Источник тендера: Единая система закупок Европейского союза TED |
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CEA Grenoble (ID: ORG-0001)
Address: , Grenoble, 38000
Contacts:
Tel: 04 38 78 23 19
Email: valerie.dielna@cea.fr
Web: www.cea.fr
Company ID: 775 685 109 00298
GREFFE DU TRIBUNAL ADMINISTRATIF DE GRENOBLE (ID: ORG-0002)
Address: 2 Place de Verdun, Grenoble Cedex, 38022
Contacts:
Tel: +33 47642900
Email: greffe.ta-grenoble@juradm.fr
Web: http://grenoble.tribunal-administratif.fr
Company ID: 173800053
Publications Office of the European Union (ID: ORG-0000)
Address: , Luxembourg, 2417
Contacts:
Tel: +352 29291
Email: ted@publications.europa.eu
Web: https://op.europa.eu
Company ID: PUBL
Description: Les prestations confiées au titulaire seront des prestations de layouts de blocs analogiques et mixtes. Ces blocs seront décrits sous forme de schémas annotés disponibles dans une base de données Cadence au démarrage de la tâche. Une base de données de circuit intégré rassemble notamment tous schémas constituant le circuit, organisés de façon hiérarchique. L’implémentation physique de ces schémas va se faire en plusieurs étapes et selon plusieurs granularités. On peut les décrire ainsi : Layout d’un schéma de bloc : - Analyse du schéma : o Identification des points sensibles, des contraintes topologiques, des précautions d’implémentation à prendre o Proposition d’un floorplan du bloc et évaluation de la surface - Réalisation du layout : o Placement et connexion des composants o Proposition de modification mineure schéma si pertinent - Réalisation des vérifications : o DRC o LVS A l’issue des étapes de layout, des vues schémas intégrant les éléments parasites induits par l’implémentation physique sont extraites et simulées par les concepteurs CEA pour valider l’adéquation du layout avec la performance attendue. En cas de performances insuffisantes, une reprise pour optimisation du layout peut être demandée. Layout d’assemblage de blocs entre eux en macro-blocs : les étapes sont sensiblement les même que pour les blocs unitaires, (analyse, layout, vérifications), mais à un niveau de hiérarchie supérieur. La complexité de ces assemblages dépend du nombre des signaux d’interface, des contraintes topologiques diverses (contraintes d’alimentations, d’isolation, de limites de surfaces…) Layout d’assemblage TOP : Il s’agit de faire l’assemblage aux plus hauts niveaux du circuit, entre les plots (souvent organisés en couronne), et les macro-blocs de plus haut niveau. Cet assemblage est très différent si le TOP du circuit est dit « numérique » ou « analogique ». Les assemblages TOP considérés pour les tâches de layout seront uniquement des TOP analogiques.
Issue Date: 21.01.2026 03:00
Submission Deadline: 23.01.2026 18:00
CPV Codes: 73300000
Documentation: www.marchespublics.gouv.fr